기술 개요
“2차원 반도체의 계면과 스위칭 구조를 제어해 안정적인 저전력 동작과 다치 논리 구현 가능성을 확보하는 기술입니다.”
산업 별 활용 방안
차세대 로직 반도체를 개발하는 반도체 소자 기업·기관
미세화가 진행된 로직 소자는 전력 소모와 스위칭 특성을 함께 개선해야 하며, 새로운 채널 소재를 적용할 때 계면 결함과 소자 동작 편차가 개발 부담이 됩니다. 본 기술은 2차원 반도체 채널에 계면 패시베이션·임계 스위칭·이종접합 설계를 결합해 저전력 스위칭과 다치 논리 소자 구조를 검토하는 기반으로 활용할 수 있습니다. 기존 공정을 즉시 대체하기보다 소자 구조 설계, 공정 조건 검증, 시험 소자 제작 단계부터 공동 연구로 결합할 수 있습니다.
디스플레이 백플레인용 트랜지스터를 개발하는 기업·기관
디스플레이 백플레인용 트랜지스터는 반복 구동 중에도 일정한 켜짐·꺼짐 특성을 유지해야 하며, 계면 결함에 따른 히스테리시스는 화소 구동 안정성 검토의 부담이 됩니다. 유기 도펀트층과 자가 성장 단층을 활용한 계면 트랩 제어를 적용해 2차원 반도체 트랜지스터의 스위칭 안정성을 개선하는 방향으로 활용할 수 있습니다. 기존 백플레인 구조 전체를 바꾸기보다 후보 채널 소재와 절연막 조합에 적용해 공정 호환성과 전기적 특성을 단계적으로 평가할 수 있습니다.
차세대 메모리·로직 융합 소자를 개발하는 기업·기관
메모리와 로직 기능을 결합하거나 회로당 처리 정보를 늘리려는 개발에서는 소자의 전류 상태를 명확히 구분하고, 낮은 전압에서 재현 가능한 동작 조건을 확보하는 일이 중요합니다. 본 기술은 임계 스위칭 소자의 전압 제어와 이종접합 기반 다치 논리 구조를 이용해 다단계 전류 상태와 문턱 전압 제어를 검토하는 소자 플랫폼으로 활용할 수 있습니다. 회로 적용 전에는 단위 소자의 전기적 특성, 공정 재현성, 집적 환경의 신뢰성을 순차적으로 검증하는 방식으로 도입할 수 있습니다.
기술 설명
어떤 기술인가요?
2차원 반도체 트랜지스터는 원자 수준으로 얇은 반도체를 전류가 흐르는 채널로 활용해, 기존 실리콘 소자의 미세화 한계를 보완할 후보로 연구되는 소자입니다. 본 기술 포트폴리오는 2차원 반도체 채널의 계면 결함을 줄이고 스위칭 특성을 제어하는 소자·공정 기술로, 유기 도펀트층으로 게이트 절연막의 계면 트랩을 패시베이션해 히스테리시스를 낮추고(특허 4), 자가 성장 단층으로 터널링 전류와 구동 전압을 제어하며(특허 3), 이종접합 채널의 선택 도핑으로 다단계 논리 상태를 형성하고(특허 2), 임계 스위칭 소자를 게이트에 결합해 오프 전류와 문턱 전압을 조절하는(특허 1) 기법으로 구성됩니다. 이를 통해 안정적 스위칭, 저전력 구동, 다치 논리 회로 적용을 함께 검토할 수 있습니다.
어떤 문제를 해결하나요?
1. 계면 결함에 따른 스위칭 불안정
2차원 반도체 채널과 게이트 절연막의 경계에는 전하를 붙잡는 계면 트랩이 생길 수 있어, 같은 소자도 전압을 올릴 때와 내릴 때 켜짐·꺼짐 조건이 달라지는 히스테리시스가 발생합니다. 유기 도펀트 또는 자가 성장 단층을 계면에 형성해 트랩을 패시베이션하고 채널 도핑 상태를 조절함으로써, 스위칭 조건의 변동과 과잉 터널링 전류를 줄이도록 설계합니다.
2. 낮은 전력에서의 급격한 스위칭 확보
기존 2차원 트랜지스터는 게이트 전압 변화에 대한 전류 전환이 완만하거나, 오프 상태에서도 전류가 발생해 대기 전력 손실로 이어질 수 있습니다. 게이트에 임계 스위칭 구조를 연결하고 전극의 일함수 차이와 금속 이온 이동을 활용해 설정 전압과 문턱 전압을 제어함으로써, 필요한 전압 구간에서 전류를 급격히 전환하도록 구성합니다.
3. 한 소자에서 더 많은 논리 상태 구현
일반적인 이진 논리 회로는 한 신호를 두 상태로만 처리하므로, 더 많은 정보를 다루기 위해 회로 구성과 소자 수가 늘어날 수 있습니다. n형·p형 2차원 반도체 이종접합의 도핑 조건과 전류 피크 위치를 조절하고, 서로 다른 특성의 소자를 결합해 3진수·4진수 논리 상태를 구현할 수 있는 구조를 제안합니다.
연구자 및 특허 소개
유현용
고려대학교 전기전자공학부
Lam Research Corporation Process Engineer
Intel Corporation Senior Engineer
現 고려대학교 전기전자공학부 교수
“저는 2차원 반도체 물질을 채널로 활용하는 초박막 트랜지스터를 대상으로, 계면 제어와 스위칭 구조 설계를 통해 안정적인 동작 특성을 확보하는 기술을 연구하고 있습니다. 반도체 소자·소재 기업, 디스플레이 백플레인 개발 기업, 차세대 메모리·로직 소자 개발 기업은 이 기술을 후보 채널 소재와 공정 조건의 검증, 다치 논리 소자 구조 설계에 활용할 수 있습니다. 소자 구조부터 제조 방법까지 연계해 확보한 기반을 바탕으로, 실제 공정 검증과 공동 연구를 통해 적용 가능성을 함께 확인하고자 합니다.”
기술과 관련된 특허 4건
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